کد مقاله | کد نشریه | سال انتشار | مقاله انگلیسی | نسخه تمام متن |
---|---|---|---|---|
713912 | 892177 | 2013 | 6 صفحه PDF | دانلود رایگان |
عنوان انگلیسی مقاله ISI
An IP-Core Generator for Circuits performing Arithmetic Multiplication
دانلود مقاله + سفارش ترجمه
دانلود مقاله ISI انگلیسی
رایگان برای ایرانیان
موضوعات مرتبط
مهندسی و علوم پایه
سایر رشته های مهندسی
مکانیک محاسباتی
پیش نمایش صفحه اول مقاله
چکیده انگلیسی
The paper presents a computer program 'VHDLMultGenerator', which is an IP core generator supporting synthesis of arithmetic multiplication. On the basis of some simple options selected by the user the program generates a synthesizable VHDL code of a multiplication block which can be incorporated in a bigger design. The VHDL code uses a mixed dataflow and structural description style at the RTL level of abstraction. The code is in general architecture-independent and can be ported to any PLD synthesis software which supports VHDL design entry. Several algorithms of performing multiplication, implemented in the IP core generator, are also briefly described.
ناشر
Database: Elsevier - ScienceDirect (ساینس دایرکت)
Journal: IFAC Proceedings Volumes - Volume 46, Issue 28, 2013, Pages 320-325
Journal: IFAC Proceedings Volumes - Volume 46, Issue 28, 2013, Pages 320-325